基于FPGA的数字电路系统设计
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作者： 崔葛瑾主编
出 版 社： 西安电子科技大学出版社
出版时间： 2008-7-1字数： 313000版次： 1页数： 206印刷时间： 2008/07/01开本： 16开印次： 1纸张： 胶版纸I S B N ： 9787560620381包装： 平装内容简介
本书结合Altera可编程器件开发平台QuartusII的应用，以FPGA为系统实现载体，介绍数字系统设计的思路与方法。
全书由绪论和第1～4章组成。绪论简单介绍了可编程器件的基本概念。第1章主要介绍QuartusII的操作方法。第2章联系数字电子技术基础课程的基本知识点介绍基础性设计案例。第3章联系工程应用介绍综合设计案例。每个设计都在说明电路工作原理的基础上，给出了分析思路，并提出了参考设计方案。第4章提出了若干数字系统的设计要求，适合作为数字电子技术课程设计的内容。本书的设计内容尽量从工程应用实践出发，力求使学生理解数字电子技术各基本知识点的互相渗透关系和工程应用背景，对学生入门研发具有一定铺垫作用。
本书的起点较低，便于自学，适合应用于本科、大专、高职以及中专等电子信息类专业的数字电子技术实验、实践课程，计算机专业的数字逻辑实验、实践课程以及非电类专业的电工电子实验课程和数字电路实验课程。
目录
绪论
第1章QuartusII应用入门
1.1QuartusII安装
1.1.1安装QuartusII 5.1软件
1.1.2指定授权文件
1.1.3安装编程硬件驱动程序
1.2QuartusII的项目和文件管理
1.2.1QuartusII的开发环境
1.2.2新项目的创建
1.2.3项目管理
1.2.4快捷键工具栏
1.2.5QuartusII的文件管理
1.3图形设计源文件编辑
1.3.1图形设计输入窗口
1.3.2元件输入和电路连线
1.3.3图形编辑器的元件库介绍
1.3.4元件图形符号的创建
1.4设计文件综合和仿真
1.4.1分析与综合
1.4.2建立仿真波形文件
1.4.3输入、输出观察点设置
1.4.4仿真输入信号编辑
1.4.5 功能仿真
1.5端口分配、项目编译适配和器件编程
1.5.1端口分配
1.5.2项目编译和器件资源适配
1.5.3端口引脚分配文本修改方法
1.5.4 FPGA编程配置接口
1.6SignalTap II嵌入式逻辑分析仪
1.6.1SignalTap II的主要特点和一般流程
1.6.2SignalTap II文件的建立和基本参数设置
1.6.3SignalTap II的节点选择和参数配置
1.6.4SignalTap II的触发事件设置
1.6.5SignalTap II的编译、下载、运行和信号显示
第2章基础设计实例
2.1全加器设计
2.1.1设计实例
2.1.2设计原理分析
2.1.3设计预习准备
2.1.4参考设计步骤
2.1.5思考问题
2.2多位串行进位加法器设计
2.2.1设计实例
2.2.2设计原理分析
2.2.3参考设计思路
2.2.4设计预习准备
2.2.5参考设计步骤
2.2.6思考问题
2.3代码转换电路设计
2.3.1设计要求
2.3.2集成加法器原理
2.3.3参考设计思路
2.3.4设计预习准备
2.3.5参考设计步骤
2.3.6思考问题
2.4BCD码优先编码电路设计
2.4.1设计要求
2.4.2集成8—3线优先编码器74148的逻辑功能
2.4.3参考设计思路
2.4.4设计预习准备
2.4.5参考设计步骤
2.4.6思考问题
2.5脉冲分频选择电路设计
2.5.1设计要求
2.5.2设计原理分析
2.5.3参考设计方案
2.5.4设计预习准备
2.5.5参考设计步骤
2.5.6思考问题
2.6汽车尾灯控制电路设计
2.6.1 设计要求
2.6.2参考设计思路
……
第3章综合设计实例
第4章系统设计实例
附录AFPGA的部分库器件名称说明
附录BEPF10K10TC144、EP1C3T144C8引脚排列
附录CLP-2900和DE2开发装置面板图
附录DLP-2900开发装置部分电路图
附录ELP-2900和DE2开发装置FPGA引脚分配
附录FDE2开发装置FPGA引脚分配
参考文献
书摘插图
第1章Quartus II应用入门
Altera 公司的可编程器件开发软件QuartusII提供了一个多平台的综合性设计环境，包括了各种形式的设计输入、功能仿真和时序仿真、布局布线、编程下载、片上嵌入式处理器软核设计、片上系统构建、数字信号处理系统构建和片上数字逻辑分析仪构建和实时信号观测等所有阶段的设计解决方案，支持所有Altera公司的FPGA和CPLD器件。
应用Quartus II开发基于可编程器件的数字电路或系统的过程如下：
（1）新项目工程创建（New Project Wizard）建立新工程并指定目标器件或器件系列。
（2）使用原理图编辑器（Block Editor）或文本编辑器（Text Editor）建立流程图、原理图设计文件或硬件描述语言设计文件。
（3）使用资源分配编辑器（Assignment Editor）、参数设置选项（Settings）、底层编辑器（Floorplan Editor）、逻辑锁定器（LogicLockTM）功能指定初始设计的约束条件。
（4）使用片上可编程系统构建平台（SOPC Builder）或数字信号处理器构建平台（DSP Builder）建立系统级设计。
（5）使用软件构建平台（Software Builder）为器件处理内核（ExcaliburTM）或嵌入式处理内核（Nios）建立控制软件编程文件。
（6）使用分析综合工具（Analysis&Synthesis）对设计文件进行分析综合。
（7）使用仿真工具（Simulator T001）对设计文件进行功能仿真或时序仿真。
（8）使用编译工具（CompiIer T001）对设计文件进行分析综合（Analysis & Synthesis）、物理层适配（Fitter）、布局布线优化组合（Assembler），底层信号传输时间分析（Timing Analyzer），产生下载编程文件。
（9）使用编程器Programmer下载设计文件对器件进行编程，或将编程文件转换为其他文件格式供嵌入式处理器等其他系统使用。
（10）若有需要，使用SignalTap II Logic Analyzer、SignalProbe TM功能对设计进行硬件实时调试。
（11）若有需要，使用Chip Editor、Resource Property Editor和Change Manager进行工程更改管理。
对于一般的数字电路或系统设计，QuartusII应用基本流程可简化为如图所示。如果FPGA或CPLD安装在用户系统或开发装置上，在项目编译前必须规划引脚分配，否则可由QuartusII任意分配输入、输出端口引脚。
……
