基于Quartus Ⅱ的FPGA/CPLD数字系统设计实例
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作者： 周润景，图雅，张丽敏编著
出 版 社： 电子工业出版社
出版时间： 2007-8-1字数： 742000版次： 1页数： 451印刷时间： 2007/08/01开本：印次：纸张： 胶版纸I S B N ： 9787121040917包装： 平装内容简介
本书介绍了使用Quartus Ⅱ7.0开发FPGA/CPLD数字系统的开发流程和设计方法，通过实例讲解，介绍了数字电路设计的原理图编辑、文本编辑和混合编辑的方法，并对大型数字系统设计实例进行了解析。本书还介绍了宏功能模块及IP核的使用方法，DSP Builder与Quartus Ⅱ结合的使用方法。本书的讲解深入浅出，实例丰富，图文并茂，系统实用。
本书可作为从事数字系统设计的科研人员的参考书，也可作为高等学校电子类专业的EDA实用教材。
目录
第1章 Altera Quartus II开发流程
1.1 Quartus II软件综述
1.1.1 Qua_rtus II软件的特点及支持的器件
1.1.2 Quartus II软件的集成工具及其功能简介
1.1.3 Quartus II软件的用户界面
1.2设计输入
1.2.1设计输入方式
1.2.2设计方法
1.3约束输入
1.3.1使用分配编辑器（Assignments Editor）
1.3.2使用引脚规划器（Pin Planner）
1.3.3使用Settings对话框
1.4综合
1.4.1使用Quartus II软件集成综合
1.4.2控制综合
1.4.3第三方综合工具
1.5布局布线
1.5.1设置布局布线参数
1.5.2反向标注分配
1.6仿真
1.6.1指定仿真器设置
1.6.2建立矢量源文件
1.6.3第三方仿真工具
1.7编程与配置
1.7.1建立编程文件
1.7.2器件编程和配置
第2章Altera Quartus II的使用
2.1原理图和图表模块编辑
2.1.1 内附逻辑函数
2.1.2编辑规则
2.1.3原理图和图表模块编辑工具
2.1.4原理图编辑流程
2.2文本编辑
2.3混合编辑（自底向上）
2.4混合编辑（自顶向下）
第3章门电路设计范例
3.1与非门电路
3.2或非门电路
3.3异或门电路
3.4三态门电路
3.5单向总线缓冲器
3.6双向总线缓冲器
第4章组合逻辑电路设计范例
4.1编码器
4.1.18线-3线编码器
4.1.28线-3线优先编码器
4.2译码器
4.2.13线-8线译码器
4.2.2BCD-7段显示译码器
4.3数据选择器
4.3.14选1数据选择器
4.3.28选1数据选择器
4.4数据分配器
4.5数值比较器
4.6加法器
4.6.1 半加器
4.6.2全加器
4.6.34位全加器
4.7减法器
4.7.1半减器
4.7.2全减器
4.7.34位全减器
第5章触发器设计范例
第6章时序逻辑电路设计范例
第7章存储器设计范例
第8章数字系统设计范例
第9章可参数化宏模块及IP核的使用
第10章DSP Builder设计范例
第11章基于FPGA的射频热疗系统的设计
第12章基于FPGA的直流电动机伺服系统的设计
附录A可编程数字开发系统简介
参考文献
